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[交流]
【求助】xilinx(FPGA)文件如何加密？ 已有2人參與
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請問如何將FPGA源代碼加密，以實現(xiàn)一部分.v文件可見并調(diào)試，另一部分.v文件加密，整體可以綜合使用。 可以使用網(wǎng)表文件（edif）或edk生成CPU核方法嗎？具體如何實現(xiàn)？ |
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2樓2010-05-04 22:59:29
yangwuow
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小木蟲(金幣+0.5):給個紅包，謝謝回帖
mze04532(金幣+2): 熱心應助，獎勵~ 2011-11-15 16:44:09
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mze04532(金幣+2): 熱心應助，獎勵~ 2011-11-15 16:44:09
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將要加密的.v文件綜合生成網(wǎng)表文件。 FPGA設計過程，很多時候在使用公司的或者第三方公司的IP核，那如何自己把自己的HDL代碼變成可使用的IP呢。同時這樣做也有很多好處： 將你的設計制作成BlackBox，也就是網(wǎng)表文件，這樣別人看不到你的設計但是可以調(diào)用你的模塊了。詳細的參考信息如下： 1. 什么是BlackBox - 一個大的設計中可以用到一系列網(wǎng)表文件作為輸入的一部分而并不全部使用HDL文件。當綜合這個大設計時綜合器不需要知道這個網(wǎng)表文件是怎樣實現(xiàn)的，而只需要知道它的輸入輸出接口就可以了。這樣的網(wǎng)表就稱為黑盒子，因為我們不需要看到它的內(nèi)部情況。 - 通常付費IP都會以BlackBox的形式 2. 如何使用BlackBox - BlackBox網(wǎng)表可以是EDIF或NGC文件。 - 每個BlackBox網(wǎng)表都需要有一個與之相對應的HDL文件來注明它的端口。這個HDL只說明BlackBox的端口信息，而不提供具體實現(xiàn)信息。這個只提供端口信息的HDL文件稱為Wrapper。Wrapper的名字通常需要與BlackBox網(wǎng)表的名字相同。 - 在ISE工程中使用BlackBox時只需要將它的Wrapper添加到工程中。然后像普通的模塊一樣在其上層聲明和例化就可以使用。 - BlackBox網(wǎng)表文件可以放在ISE工程目錄中，也可以放在其他任意文件夾內(nèi)。當不放在ISE工程目錄時，需要在Translate屬性中將Macro Search Path指向這個目錄。多個目錄使用"|"分割。 3. 如何制作BlackBox - BlackBox只是普通網(wǎng)表而已。XST的綜合結果就可以直接作為BlackBox使用。 - 通常BlackBox外部還會連接其他邏輯，所以BlackBox中一般不插入IOBUF。在XST屬性中去除Insert IO Buffer的選項 1. 一般收費的IP都是只提供網(wǎng)表供使用，自然對設計的保密是一大好處； 2. IP都是驗證好的模塊，提供給外界接口，自然使用方便也是一大特點； |
3樓2011-08-29 21:36:16
4樓2011-11-15 16:16:38
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