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lovewater木蟲 (正式寫手)
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[交流]
廣創(chuàng)團隊招聘多個職位
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職位名稱 DSP軟件工程師 職位類別 計算機軟件 招聘人數(shù) 1 職位描述 “人造視網(wǎng)膜”團隊，依托中科院深圳先進技術研究院，獲得廣東省和深圳市7800萬經(jīng)費支持，致力于開發(fā)高分辨率的下一代人造視網(wǎng)膜技術，是更多由于視網(wǎng)膜病變而失明的患者恢復一定視覺。 本職位負責電子產(chǎn)品方案設計、電路設計，參與項目討論，負責項目中DSP程序的設計、代碼編寫及測試，并設計文檔的整理、撰寫及審核。 崗位要求 最低學歷：本科以上學歷； 工作年限： 2年以上計算機專業(yè)經(jīng)驗，在醫(yī)療器械行業(yè)經(jīng)驗者優(yōu)先； 專業(yè)：計算機、電子工程等相關專業(yè)； 語言： 相關能力：(1)、具有在DSP平臺開發(fā)或測試實時嵌入式軟件的經(jīng)驗； (2)、精通編程使用語言如C，C + +，Java，Python等； (3)、精通MATLAB或Minitab、SAS等； (4)、具有撰寫工程相關技術文件的能力； (5)、具有閱讀，分析，并解釋常見科技期刊的能力； (6)、有Simulink經(jīng)驗者優(yōu)先； (7)、具有對算法的故障檢測、一般性生物信號分析的經(jīng)驗者優(yōu)先； 其他： 簡歷接收 郵箱 yu_zhao@siat.ac.cn 職位名稱 IC LAYOUT工程師 職位類別 電子技術 招聘人數(shù) 1 職位描述 “人造視網(wǎng)膜”團隊，依托中科院深圳先進技術研究院，獲得廣東省和深圳市7800萬經(jīng)費支持，致力于開發(fā)高分辨率的下一代人造視網(wǎng)膜技術，是更多由于視網(wǎng)膜病變而失明的患者恢復一定視覺。 本職位負責數(shù)�；旌闲盘栯娐返陌鎴D設計，能夠根據(jù)電路，獨立完成相應的版圖設計以及LVS, DRC、ERC 驗證。 崗位要求 最低學歷：本科以上學歷； 工作年限： 2年以上IC版圖設計經(jīng)驗，有大型電子、儀器、儀表公司經(jīng)驗者優(yōu)先； 專業(yè)：電子、計算機、通訊相關專業(yè) 語言： 相關能力：(1)、熟悉Cadence 、Calibre等EDA工具，會用virtuoso XL或者會創(chuàng)建PCELL的優(yōu)先； (2)、了解集成電路工藝流程及工藝基礎知識； (3)、具有數(shù)�；旌闲盘栯娐稬ayout 經(jīng)驗； (4)、具有撰寫腳本文件或能撰寫 DRC /LVS command file的能力； 其他： 簡歷接收 郵箱 yu_zhao@siat.ac.cn 職位名稱 機械設計工程師 職位類別 機械工程 招聘人數(shù) 1 職位描述 “人造視網(wǎng)膜”團隊，依托中科院深圳先進技術研究院，獲得廣東省和深圳市7800萬經(jīng)費支持，致力于開發(fā)高分辨率的下一代人造視網(wǎng)膜技術，是更多由于視網(wǎng)膜病變而失明的患者恢復一定視覺。 本職位負責開發(fā)與設計小型機械部件，繪制產(chǎn)品裝配圖及部件圖和相應的工藝文件，對設計的新零部件編制加工及維護老零部件的加工工藝，解決生產(chǎn)中出現(xiàn)的機械加工問題和裝配問題。 崗位要求 最低學歷：本科以上學歷； 工作年限： 2年以上經(jīng)驗，有大型電子、儀器、儀表公司經(jīng)驗者優(yōu)先； 專業(yè)： 機械設計類相關專業(yè) 語言： 相關能力： (1)、具備結構設計，或殼體、小型手持設備的機械設計經(jīng)驗； (2)、熟練使用SOLID WORKS工具，掌握PROE、CAD、UG等繪圖軟件； (3)、能夠獨立進行產(chǎn)品機械部分的設計開發(fā)和現(xiàn)場調試，熟悉ISO9000質量體系； 其他： 簡歷接收 郵箱 yu_zhao@siat.ac.cn 職位名稱 硬件測試工程師（模擬射頻集成電路方向） 職位類別 電子技術 招聘人數(shù) 1 職位描述 “人造視網(wǎng)膜”團隊，依托中科院深圳先進技術研究院，獲得廣東省和深圳市7800萬經(jīng)費支持，致力于開發(fā)高分辨率的下一代人造視網(wǎng)膜技術，是更多由于視網(wǎng)膜病變而失明的患者恢復一定視覺。 本職位負責模擬射頻集成電路的驗證測試，與研發(fā)人員共同確定測試方案并完成調試工作，同時參與產(chǎn)品開發(fā)階段的設計評審。 崗位要求 最低學歷：本科以上學歷 工作年限： 2年以上集成電路版級測試經(jīng)驗，有大型電子、儀器、儀表公司經(jīng)驗者優(yōu)先； 專業(yè)：電子工程、機電工程、測試技術和自動化等相關專業(yè)； 語言：中文，英文 相關能力： (1)、具有扎實的數(shù)字、模擬電路的知識，具有一定的模擬與數(shù)字電路設計能力； (2)、了解產(chǎn)品的開發(fā)流程，能協(xié)助硬件工程師完成設計文檔的編寫；具備較強的包括焊接、裝配和調試等動手能力； (3)、精通焊接和各種飛線工作； (4)、熟悉各種測試儀器（示波器、邏輯分析儀等）的使用； (5)、熟悉基本EDA軟件（如PADS、Protel等）使用。 其他： 簡歷接收 郵箱 yu_zhao@siat.ac.cn 職位名稱 硬件測試工程師（模擬射頻集成電路方向） 職位類別 電子技術 招聘人數(shù) 1 職位描述 “人造視網(wǎng)膜”團隊，依托中科院深圳先進技術研究院，獲得廣東省和深圳市7800萬經(jīng)費支持，致力于開發(fā)高分辨率的下一代人造視網(wǎng)膜技術，是更多由于視網(wǎng)膜病變而失明的患者恢復一定視覺。 本職位負責模擬射頻集成電路的設計。 崗位要求 最低學歷：本科以上學歷 工作年限： 2年以上模擬電路設計經(jīng)驗，有大型電子、儀器、儀表公司經(jīng)驗者優(yōu)先； 專業(yè)：電子工程、機電工程、測試技術和自動化等相關專業(yè)； 語言：中文，英文 相關能力：1) 有醫(yī)療植入式低功率電路設計經(jīng)驗； 2) 有醫(yī)療植入式低功率電路、電荷泵、能量收集、可充電式電池充電電路設計經(jīng)驗； 3) 有醫(yī)療植入式射頻通信電路和系統(tǒng)設計經(jīng)驗； 4) 有運算放大器、低噪聲DC-DC 變換器、濾波器、ADC 與 DAC整流器，RF 驅動器/接收器的經(jīng)驗； 5) 熟悉仿真和CAD工具、PCB布線工具、Matlab，有系統(tǒng)的建立與調試經(jīng)驗。 其他： 簡歷接收 郵箱 yu_zhao@siat.ac.cn 職位名稱 FPGA/ASIC設計工程師 職位類別 電子系統(tǒng) 招聘人數(shù) 1 職位描述 “人造視網(wǎng)膜”團隊，依托中科院深圳先進技術研究院，獲得廣東省和深圳市7800萬經(jīng)費支持，致力于開發(fā)高分辨率的下一代人造視網(wǎng)膜技術，是更多由于視網(wǎng)膜病變而失明的患者恢復一定視覺。 本職位負責利用高密度FPGA產(chǎn)品實現(xiàn)控制設計和芯片系統(tǒng)，并且完成向ASIC/SoC設計的轉化，包括了FPGA/ASIC開發(fā)設計中的各個方面，如芯片架構，RTL實現(xiàn)，RTL合成，驗證，實驗室驗證和表征。 崗位要求 最低學歷：本科以上學歷； 工作年限：2年以上FPGA / ASIC設計經(jīng)驗； 專業(yè)：電子工程、機電工程、計算機等相關專業(yè)； 語言： 相關能力： (1)、有數(shù)字ASIC和FPGA經(jīng)驗。有 FPGA / ASIC設計方法的專業(yè)知識，包括Verilog， VHDL，時序約束，時序收斂，合成，驗證； (2)、了解同步、異步電路設計； (3)、熟悉Verilog、VHDL編程； (4)、具備Perl，MATLA, a Plus知識； (5)、具備高級復雜FPGA相關知識。 (6)、有Xilinx FPGA實現(xiàn)知識流動和ISE設計工具經(jīng)驗（包括COREGEN和ChipScope）； (7)、有Modelsim仿真工具經(jīng)驗； 其他： 簡歷接收 郵箱 yu_zhao@siat.ac.cn 職位名稱 ASIC & SoC設計工程師 職位類別 電子技術 招聘人數(shù) 1 職位描述 “人造視網(wǎng)膜”團隊，依托中科院深圳先進技術研究院，獲得廣東省和深圳市7800萬經(jīng)費支持，致力于開發(fā)高分辨率的下一代人造視網(wǎng)膜技術，是更多由于視網(wǎng)膜病變而失明的患者恢復一定視覺。 本職位負責人應該具備數(shù)字IC/Soc設計的技能。另外曾經(jīng)參與和主持過復雜或者較復雜的ASIC設計項目，包括模擬和混合。 崗位要求 最低學歷：本科以上學歷，電氣工程碩士學位優(yōu)先； 工作年限：2年以上數(shù)字集成電路設計經(jīng)驗，有大型電子、儀器、儀表公司經(jīng)驗者優(yōu)先； 專業(yè)：電子工程、機電工程、測試技術和自動化等相關專業(yè)； 語言： 相關能力：(1)、熟練掌握 VHDL或Verilog； (2)、具備較強的較強的RTL編碼和調試能力； (3)、具備執(zhí)行仿真、邏輯綜合、測試設計（DFT）、靜態(tài)時序分析（STA）、功能驗證、物理驗證和ASIC供應商認定方法的能力。 (4)、有數(shù)字系統(tǒng)的體系結構和低功耗設計經(jīng)驗； (5)、了解 ASIC物理設計流程和測試。 (6)、廣泛了解FPGA供應商技術，實現(xiàn)平臺驗證和系統(tǒng)集成； (7)、掌握扎實的CPU，GPU，DSP體系結構和算法，針對硬件架構與實現(xiàn)，進行折中方案； (8)、具備標準芯片接口的工作知識（如I2S，I2C），能夠理解與開發(fā)針對不同應用的互聯(lián)設計； (9)、有ModelSim或Design Compiler、PrimeTime、Calibre、FastScan等相關工具的操作經(jīng)驗； (10)、具備使用探針臺，頻譜分析儀，示波器，信號發(fā)生器，邏輯分析儀等測試設備，對硅芯片進行分析和調試經(jīng)驗； (11)、具備直接或間接的先進IC失效分析技術的經(jīng)驗，包括FIB、 SQUID、Liquid Crystal等； (12)、精通嵌入式系統(tǒng)（峰值與平均MIPS，功率情況，線程和RTOS模型，HW加速器）對于硬件結構和實現(xiàn)的相互作用； 其他： 簡歷接收 郵箱 yu_zhao@siat.ac.cn |
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